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[IT뉴스]삼성 파운드리, AI 시대 '넥서스' 선언…"2나노·HBM4로 생태계 주도"

온카뱅크관리자

2026-07-01 12:27:28

<div id="layerTranslateNotice" style="display:none;"></div> SAFE 포럼 2026 개최…신종신 부사장, 3대 파운드리 혁신 청사진 제시 
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 (지디넷코리아=전화평 기자)"인공지능(AI)의 대전환 시대, 삼성 파운드리는 제품과 인프라, 고객과 파트너를 연결하는 '넥서스(Nexus)'로 진화할 것입니다."
 신종신 삼성전자 디자인플랫폼(DP) 개발실장(부사장)이 1일 서울 강남 서초사옥에서 열린 SAFE(Samsung Advanced Foundry Ecosystem) 포럼 기조연설에서 이처럼 밝혔다. '넥서스'란 서로 다른 것들을 하나로 묶는 중심이자 연결고리를 뜻한다.
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 <img alt="삼성전자가 1일 삼성전자 서초사옥에서 '세이프 포럼 2026(SAFE Forum 2026)'를 개최했다. 삼성전자 파운드리 사업부 Design Platform 개발실 신종신 부사장이 기조연설을 하고 있다.(사진=삼성전자)" class="thumb_g_article" data-org-src="https://t1.daumcdn.net/news/202607/01/ZDNetKorea/20260701122204198powc.jpg" data-org-width="639" dmcf-mid="ZGn5npd8aQ" dmcf-mtype="image" height="auto" src="https://img3.daumcdn.net/thumb/R658x0.q70/?fname=https://t1.daumcdn.net/news/202607/01/ZDNetKorea/20260701122204198powc.jpg" width="658">
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 삼성전자가 1일 삼성전자 서초사옥에서 '세이프 포럼 2026(SAFE Forum 2026)'를 개최했다. 삼성전자 파운드리 사업부 Design Platform 개발실 신종신 부사장이 기조연설을 하고 있다.(사진=삼성전자)
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 신 부사장은 "과거 메모리 반도체는 단일 기업이 완제품을 뚝딱 만들 수 있었지만, 오늘날 고성능 AI 로직(연산) 칩은 팹리스(설계기업)부터 파운드리(위탁생산)까지 수많은 파트너의 긴밀한 연결 없이는 구현이 불가능하다"며 "생각하는 실리콘(AI)을 완성하려면 로직 칩 설계와 이를 만드는 파운드리 역할이 가장 중요하다"고 설명했다.
 신 부사장은 이를 위해 ▲공정 미세화 ▲차세대 메모리 결합 ▲설계 생태계 혁신 등 3가지 청사진을 제시했다.
 미세 공정 한계 넘는 '설계·제조 최적화'와 HBM4 시너지
 청사진의 첫 번째 축은 최첨단 반도체 제조 공정 로드맵 구체화와 'DTCO(Design-Technology Co-Optimization)' 기술 극대화다. 
 신 부사장은 "가장 앞선 1.4nm(나노미터, 10억분의 1m) 공정(SF1.4)은 2029년 양산을 목표로 순조롭게 개발 중이고, 수율과 성능을 한층 더 끌어올린 개량형 노드 SF1.4 플러스는 2030년에 선보일 예정"이라고 타임라인을 공식화했다. 
 시장 수요가 높은 2나노 공정 역시 2027년에서 2028년 사이 성능 개량 버전인 SF2P 플러스로 전환되고, 이후 후속 공정 SF2X로 진화한다. SF2X는 SF2P, SF2P 플러스와 IP 호환성을 유지하는 차세대 공정이다.
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 삼성전자가 1일 삼성전자 서초사옥에서 '세이프 포럼 2026(SAFE Forum 2026)'를 개최했다. 삼성전자 파운드리 사업부 Design Platform 개발실 신종신 부사장이 기조연설을 하고 있다.(사진=삼성전자)
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 공정 미세화의 물리적 한계는 DTCO로 극복할 계획이다. DTCO는 설계와 제조 공정을 동시에 맞물려 최적화하는 기술이다.
 신 부사장은 "2나노 공정의 경우 전력 소모를 26% 줄였는데, 개선 효과 절반 이상이 DTCO 덕분"이라며 "세대가 지날수록 성능 향상의 거의 대부분을 DTCO가 차지할 것"이라고 전망했다. 아울러 AI 칩의 필수요소인 S램을 세계 최소형 크기로 구현해 고밀도 데이터 저장 능력을 확보했다. 
 두 번째 축은 로직과 메모리의 통합이다. 차세대 초고속 AI 메모리인 6세대 고대역폭메모리(HBM4)는 칩의 밑바탕인 베이스 다이 역할이 중요한데, 삼성은 이를 자사 4나노 공정(SF4X)으로 만들고 있다.
 신 부사장은 "메모리 사업부와 긴밀한 협력 덕분에 초당 10기가비트(Gbps) 속도에서도 아주 깨끗한 신호를 확인했고, 최대 11.7Gbps까지 안정적으로 속도를 높일 수 있는 기술 여유(마진)를 충분히 확보했다"고 자신했다.
 특히 칩과 칩을 연결할 때 기존 수작업 중심의 아날로그 방식 설계 때문에 오래 걸렸던 검증 작업도 바꿨다. 3D 'D램 파이(D램 PHY)'라는 디지털 자동화 방식을 개발해 고객들의 칩 설계와 시뮬레이션 시간을 단축할 계획이다.
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 <img alt="삼성전자 4나노 공정으로 양산되고 있는 그록3 LPU 웨이퍼가 SAFE 포럼에 전시됐다.(사진=지디넷코리아)" class="thumb_g_article" data-org-src="https://t1.daumcdn.net/news/202607/01/ZDNetKorea/20260701122206758ifnr.jpg" data-org-width="640" dmcf-mid="FO7rbhztg4" dmcf-mtype="image" height="auto" src="https://img4.daumcdn.net/thumb/R658x0.q70/?fname=https://t1.daumcdn.net/news/202607/01/ZDNetKorea/20260701122206758ifnr.jpg" width="658">
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 삼성전자 4나노 공정으로 양산되고 있는 그록3 LPU 웨이퍼가 SAFE 포럼에 전시됐다.(사진=지디넷코리아)
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 "지원군 없인 제품도 없다"… 2026년 설계 플랫폼 대혁신
 세 번째 축은 디자인하우스, IP 기업 등 파트너 생태계 강화다.
 신 부사장은 "당사의 모든 노력도 결국 에코(생태계)가 없이는 완제품으로 탄생할 수 없다"며 IP(설계자산) 파트너와 협력을 거듭 강조했다. 삼성 파운드리는 현재 4나노 IP를 확충하는 것은 물론, 수많은 신규 IP를 차세대 2나노 공정 기반으로 개발하고 있다. 하나의 설계 기능이라도 여러 파트너 IP를 확보해 고객 선택지를 넓힌다는 전략이다. 
 고객과 파트너가 삼성 파운드리 자산을 더 쉽게 이용하도록 소통 플랫폼인 B2B 웹사이트 '커넥트(Connect)'도 2026년을 기점으로 완전히 탈바꿈한다. 신 부사장은 "사용자가 한눈에 알아보기 쉽도록 화면(UI·UX)을 직관적으로 개편하고, 실시간 대응이 가능한 AI 챗봇과 강력한 문서 검색 기능을 새롭게 도입할 것"이라고 밝혔다. 
 전화평 기자(peace201@zdnet.co.kr)
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